職責說明：1. 無線通信IP和SOC芯片的前端設計、integration和實現2. 依據算法和性能要求進行數字模塊及RF模塊數字部分的設計及基本驗證；3. 熟練使用verilog，按照要求進行RTL設計；4. 負責front-end integration flow，負責部分back-end integration flow ；5. 針對功耗、性能、面積等需求，在RTL階段進行分析和優(yōu)化；6. 熟練使用基本的驗證方法進行各個階段的驗證和debug；7. 具備良好的溝通能力以及團隊合作精神；8. 完成相關的技術文檔，提供技術支持；任職要求：1. 本科及以上學歷，3年以上芯片設計或者FPGA設計和實現經驗，電子、通信、集成電路、計算機等相關專業(yè)畢業(yè)，有良好的數字電路設計知識，有良好的無線通信基礎知識2. 熟練掌握數字IC開發(fā)和設計流程:(VCS/SDC check/CDC/Synthesis/STA/Formal/DFT)，了解無線通信芯片設計注意事項和基本流程；3. 熟練使用VCS，Verdi等仿真和debug工具，了解驗證方法基本思路，能有效進行驗證和debug4. 能熟練使用并開發(fā)自動化腳本者優(yōu)先(TCL/Perl/Makefile/Python…)；5. 熟悉SoC架構、時鐘架構、功耗優(yōu)化，有PPA優(yōu)化經驗，熟悉總線協(xié)議(AMBA/SPI/UART/DMA)者優(yōu)先6. 對芯片技術有濃厚興趣，性格沉穩(wěn) ，責任心強，工作細致，善于溝通，團隊協(xié)作能力強

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